基于fpga的数字钟设计 (vhdl语言实现).doc
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基于fpga的数字钟设计 (vhdl语言实现),本科毕业论文 基于fpga的数字钟设计 (vhdl语言实现)46页共计24105字摘要本设计为一个多功能的数字钟，具有年、月、日、时、分、秒计数显示功能，以24小时循环计数；具有校对功能以及整点报时功能。本设计采用eda技术，以硬件描述语言vhdl为系统逻辑描述手段设计文件，在maxplusii工具软件环境下，采用自顶...
内容介绍
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本科毕业论文 基于FPGA的数字钟设计 (VHDL语言实现)
46页共计24105字
摘要
本设计为一个多功能的数字钟，具有年、月、日、时、分、秒计数显示功能，以24小时循环计数；具有校对功能以及整点报时功能。
本设计采用EDA技术，以硬件描述语言VHDL为系统逻辑描述手段设计文件，在MaxplusII工具软件环境下，采用自顶向下的设计方法，由各个基本模块共同构建了一个基于FPGA的数字钟。
系统主芯片采用EP1K100QC208-3，由时钟模块、控制模块、计时模块、数据译码模块、显示以及报时模块组成。经编译和仿真所设计的程序，在可编程逻辑器件上下载验证，本系统能够完成年、月、日和时、分、秒的分别显示，由按键输入进行数字钟的校时、清零、启停功能。
Abstract
The design for a multi-functional digital clock, with a year, month, day, hours, minutes and seconds count display to a 24-hour cycle count; have proof functions and the whole point timekeeping function.
The use of EDA design technology, hardware-description language VHDL description logic means for the system design documents, in MaxplusII tools environment, a top-down design, by the various modules together build a FPGA-based digital clock.
The main system chips used EP1K100QC208-3, make up of the clock module, control module, time module, data decoding module, display and broadcast module. After compiling the design and simulation procedures, the programmable logic device to download verification, the system can complete the year, month, day and the hours, minutes and seconds respectively, using keys to modify, cleared , start and stop the digital clock.
Keywords digital clock; hardware description language; VHDL; FPGA; keyboard interface
目录
1 绪论 1
1.1 选题背景 1
1.1.1 课题相关技术的发展 2
1.1.2 课题研究的必要性 2
1.2 课题研究的内容 3
2 FPGA简介 4
2.1 FPGA概述 4
2.2 FPGA基本结构 4
2.3 FPGA系统设计流程 7
2.4 FPGA开发编程原理 8
3 数字钟总体设计方案 10
3.1 数字钟的构成 10
3.2 数字钟的工作原理 11
4 单元电路设计 13
4.1 分频模块电路设计与实现 13
4.2 校时控制模块电路设计与实现 14
4.2.1 键盘接口电路原理 14
4.2.2 键盘接口的VHDL描述 15
4.3 计数模块设计与实现 23
4.3.1 秒计数模块 23
4.3.2 日计数模块 25
4.3.3 月计数和年计数模块 28
4.4 动态扫描及显示电路设计与实现 30
4.4.1 动态扫描模块 30
4.4.2 显示模块 31
5 实验结论与研究展望 32
5.1 实验结论 32
5.2 研究展望 33
致谢 34
附录 35
参考文献 41
关键字： 数字钟；硬件描述语言；VHDL；FPGA；键盘接口
参考文献
[1] 刘君，常明，秦娟，基于硬件描述语言（VHDL）的数字时钟设计，天津理工大学学报，2007，第23卷 第4期，40-41
[2] 廖日坤，CPLD/FPGA嵌入式应用开发技术白金手册，中国电力出版社，2003，212-218。
[3] 王开军,姜宇柏，面向CPLD/FPGA的VHDL设计,机械工业出版社,2006，28-65。
[4] 赵保经，中国集成电路大全，国防工业出版社,1985。
[5] 高吉祥，电子技术基础实验与课程设计，电子工业出版社，2002。
[6] 吕思忠，数子电路实验与课程设计，哈尔滨工业大学出版社，2001。
[7] 谢自美，电子线路设计、实验、测试，华中理工大学出版社，2003。
[8] 赵志杰，集成电路应用识图方法，机械工业出版社，2003，35-40。
[9] 张庆双，电子元器件的选用与检测，机械工业出版社，2003。
46页共计24105字
摘要
本设计为一个多功能的数字钟，具有年、月、日、时、分、秒计数显示功能，以24小时循环计数；具有校对功能以及整点报时功能。
本设计采用EDA技术，以硬件描述语言VHDL为系统逻辑描述手段设计文件，在MaxplusII工具软件环境下，采用自顶向下的设计方法，由各个基本模块共同构建了一个基于FPGA的数字钟。
系统主芯片采用EP1K100QC208-3，由时钟模块、控制模块、计时模块、数据译码模块、显示以及报时模块组成。经编译和仿真所设计的程序，在可编程逻辑器件上下载验证，本系统能够完成年、月、日和时、分、秒的分别显示，由按键输入进行数字钟的校时、清零、启停功能。
Abstract
The design for a multi-functional digital clock, with a year, month, day, hours, minutes and seconds count display to a 24-hour cycle count; have proof functions and the whole point timekeeping function.
The use of EDA design technology, hardware-description language VHDL description logic means for the system design documents, in MaxplusII tools environment, a top-down design, by the various modules together build a FPGA-based digital clock.
The main system chips used EP1K100QC208-3, make up of the clock module, control module, time module, data decoding module, display and broadcast module. After compiling the design and simulation procedures, the programmable logic device to download verification, the system can complete the year, month, day and the hours, minutes and seconds respectively, using keys to modify, cleared , start and stop the digital clock.
Keywords digital clock; hardware description language; VHDL; FPGA; keyboard interface
目录
1 绪论 1
1.1 选题背景 1
1.1.1 课题相关技术的发展 2
1.1.2 课题研究的必要性 2
1.2 课题研究的内容 3
2 FPGA简介 4
2.1 FPGA概述 4
2.2 FPGA基本结构 4
2.3 FPGA系统设计流程 7
2.4 FPGA开发编程原理 8
3 数字钟总体设计方案 10
3.1 数字钟的构成 10
3.2 数字钟的工作原理 11
4 单元电路设计 13
4.1 分频模块电路设计与实现 13
4.2 校时控制模块电路设计与实现 14
4.2.1 键盘接口电路原理 14
4.2.2 键盘接口的VHDL描述 15
4.3 计数模块设计与实现 23
4.3.1 秒计数模块 23
4.3.2 日计数模块 25
4.3.3 月计数和年计数模块 28
4.4 动态扫描及显示电路设计与实现 30
4.4.1 动态扫描模块 30
4.4.2 显示模块 31
5 实验结论与研究展望 32
5.1 实验结论 32
5.2 研究展望 33
致谢 34
附录 35
参考文献 41
关键字： 数字钟；硬件描述语言；VHDL；FPGA；键盘接口
参考文献
[1] 刘君，常明，秦娟，基于硬件描述语言（VHDL）的数字时钟设计，天津理工大学学报，2007，第23卷 第4期，40-41
[2] 廖日坤，CPLD/FPGA嵌入式应用开发技术白金手册，中国电力出版社，2003，212-218。
[3] 王开军,姜宇柏，面向CPLD/FPGA的VHDL设计,机械工业出版社,2006，28-65。
[4] 赵保经，中国集成电路大全，国防工业出版社,1985。
[5] 高吉祥，电子技术基础实验与课程设计，电子工业出版社，2002。
[6] 吕思忠，数子电路实验与课程设计，哈尔滨工业大学出版社，2001。
[7] 谢自美，电子线路设计、实验、测试，华中理工大学出版社，2003。
[8] 赵志杰，集成电路应用识图方法，机械工业出版社，2003，35-40。
[9] 张庆双，电子元器件的选用与检测，机械工业出版社，2003。
