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单片机和fpga实现位同步信号提取 毕业(设计)论文,单片机和fpga实现位同步信号提取 毕业(设计)论文76页 2万字余字有详细的设计过程，图文并茂，非常完整。附录有单片机程序和fpga芯片内部模块的verilog hdl设计任务书本课题是设计一具有通用性的输入信号的位同步提取系统，系统可以实现10hz~1mhz的信号同步。使用单片机进行实时控制现场可编程逻辑门阵列fp...
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内容介绍
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单片机和FPGA实现位同步信号提取 毕业(设计)论文
76页 2万字余字 有详细的设计过程，图文并茂，非常完整。
附录有单片机程序和FPGA芯片内部模块的Verilog HDL设计
任务书
本课题是设计一具有通用性的输入信号的位同步提取系统，系统可以实现10HZ~1MHZ的信号同步。使用单片机进行实时控制现场可编程逻辑门阵列FPGA完成位同步信号提取，通过理论和实验研究，完成硬件电路和软件设计并试制样机，要求完成：
1、单片机实时控制FPGA，完成实时频率跟踪测量和自动锁相；
2、在FPGA 内部，设计完成以下部分：
A、全数字锁相环DPLL，主要包含：数控振荡器、鉴相器、可控模分频器
B、LED动态扫描电路、FPGA和单片机的数字接口，以完成两者之间的数字传递
3、 设计辅助电路：键盘、LED；
摘 要：
本文所设计的位同步系统是使用单片机进行实时控制现场可编程门阵列（FPGA）进行同步的，在此设计中，本文主要做了以下内容：
1、单片机实时控制FPGA完成实时频率跟踪测量和自动锁相。
2、在FPGA内部，设计有以下两部分：
a、 全数字锁相环（DPLL），主要包括数控振荡器、鉴相器、可控模N分频器。
b、 LED动态扫描电路、FPGA和单片机的数据接口，以完成两者之间的数据传递。
3、设计辅助电路：键盘、LED显示、信号源等。
4、整体测试表明：系统可以实现10Hz到1MHz的信号同步，键盘及显示电路工作正常。
关键字：单片机、电子设计自动化（EDA）、Verilog HDL、数字锁相环
在科学飞速发展的今天，世界已进入了数字化、信息化的时代。其中，通信技术的发展最为迅速。从第一代模拟移动通信，到今年即将运营的3G移动通信，仅仅数年的时间。与此同时，（微）电子技术也在以很快的速度进步着，利用FPGA作原型设计及前期样品生产的作法将会逐渐流行起来。通过使用FPGA/CPLD，可得到降低成本和上市时间快等的好处。数据通信的应用需求量很大，我国路由器产品采用FPGA/CPLD起了很大作用。伴随着微电子工业的发展，今天的FPGA已经可以做系统级芯片了。技术的融合，使得各种科学技术不再独立，而是联合应用在一起，发挥更大的功效。
本课题的目的是设计出一个具有通用性的输入信号的位同步提取系统，系统可以实现10Hz~1MHz的信号同步，使用单片机进行实时控制现场可编程逻辑门阵列FPGA完成对同步信号的提取。该系统以FPGA器件作为控制的核心，配合单片机使整个系统显得尤为精简，能达到所要求的技术指标，具有灵活的现场更改性，还有高速、精确、可靠、抗干扰性强等优点。最重要的一点便是它能实现对不同的位同步信号进行提取，能够满足本课题的要求
According To The MCU And FPGA The Bit Synchronous Signal Withdraw
ABSTRACT：This text for designing the synchronous system is an usage MCU to control the Fileld Programmable Gate Array(FPGA) really．This design primarily completes missions as below．
1、 The MCU complete solid hour measure frequency follow with auto lock the phase．
2、 In the FPGA inner part ，the design have below two parts：
a． The Digital Phase Locked Loop(DPLL)，primarly include Digital Controled Oscillatory，Pahse Detector，N Divider．
b． The LED Dynamicly scan and display circuit，Interface circuit between MCU and FPGA．
3、 Design assistant electric circuit：The keyboard，LED shows，signal source etc．
4、The whole test enunciation：the system can realize 10Hz to 1MHz signal is synchronous，keyboard electric circuit and manifestation electric circuit work is normal．
KEYWORDS：MCU EDA Verilog HDL DPLL
目 录
摘 要 I
Abstract II
引 言 1
第1章 绪 论 2
1.1 位同步技术当前的发展 2
1.2 EDA简介 3
1.3 8051型单片机 4
1.4 FPGA器件简介 4
1.4.1 FPGA器件的发展 4
1.4.2 FPGA器件的结构 5
1.4.3 Altera器件及EPM7064 7
1.5 FPGA开发过程简介 8
1.6 C语言 9
1.7 VerilogHDL 9
1.8 MAX+PLUS II 概述 10
第2章 系统组成结构 11
2.1 单片机模块 11
2.2 键盘模块 11
2.3 测频、输出显示模块 12
2.4 数字锁相环(DPLL)模块 13
第3章 各模块的具体设计及实现 14
3.1 单片机模块的设计与实现 14
3.2 键盘模块的设计与实现 15
3.2.1 设计中问题和解决方法 15
3.2.2 键盘设计的软件设计 16
3.3 测频、输出显示模块的设计与实现 17
3.3.1 测频部分 17
3.3.1.1 测频电路的设计实现 17
3.3.1.2 测频模块的软件设计 17
3.3.2 显示部分 18
3.3.2.1 7448芯片介绍 18
3.4 锁相环模块的设计与实现 21
3.4.1 鉴相器的选择 21
3.4.2 可编程K可逆计数器的设计 22
3.4.3 I/D线路的设计 24
3.4.4 可编程N分频器的设计 25
第4章 位同步信号提取系统整体测试 28
4.1 锁相环的仿真与测试 28
4.2 单片机软件的测试 29
4.3 系统的整体测试 31
参考文献 33
致 谢 34
附录A 单片机软件设计程序 35
附录B FPGA芯片内部模块的Verilog HDL设计 58
部分参考文献
[6] 邬金松，李广彪．单片机并行配置FPGA的整体实现 舰船电子工程
[7] 宋宇成，宋万杰．ALTERA系列器件的集中配置方法 电子科技，
[8] 张奎刚，徐连海，张华．ALTERA FPGA简介及其在LED显示屏控制中的应用，微处理机，
[9] 王明龙，王德祥．利用Altera可编程逻辑器件开发数字电路设计 实用测试技术
[10] 潘 松，黄继业．EDA技术使用教程 北京：科学出版社
[11] 樊昌信，张甫翊，徐炳祥，吴成柯. 通信原理 北京：国防工业出版社
[12] 王迎旭．单片机原理与应用 北京：机械工业出版社
[13] 王金明,杨吉斌．数字系统设计与Verilog HDL 北京：电子工业出版
附录A 单片机软件设计程序
#include
#include
#define uchar unsigned char
#define uint unsigned int
#define ulong unsigned long
//以下端口编址采用不完全编址，再没有用到的地址线均设为1
//采用高四位片间选择，低四位片内选择。
//主要是所使用的内部元件的编址
#define PORTH_NFPQ XBYTE[0X8F] //NFPQ 高八位地址 10001111和10001110对应DATA[3..0]
#define PORTL_NFPQ XBYTE[0X8E] // NFPQ 低八位地址.......
76页 2万字余字 有详细的设计过程，图文并茂，非常完整。
附录有单片机程序和FPGA芯片内部模块的Verilog HDL设计
任务书
本课题是设计一具有通用性的输入信号的位同步提取系统，系统可以实现10HZ~1MHZ的信号同步。使用单片机进行实时控制现场可编程逻辑门阵列FPGA完成位同步信号提取，通过理论和实验研究，完成硬件电路和软件设计并试制样机，要求完成：
1、单片机实时控制FPGA，完成实时频率跟踪测量和自动锁相；
2、在FPGA 内部，设计完成以下部分：
A、全数字锁相环DPLL，主要包含：数控振荡器、鉴相器、可控模分频器
B、LED动态扫描电路、FPGA和单片机的数字接口，以完成两者之间的数字传递
3、 设计辅助电路：键盘、LED；
摘 要：
本文所设计的位同步系统是使用单片机进行实时控制现场可编程门阵列（FPGA）进行同步的，在此设计中，本文主要做了以下内容：
1、单片机实时控制FPGA完成实时频率跟踪测量和自动锁相。
2、在FPGA内部，设计有以下两部分：
a、 全数字锁相环（DPLL），主要包括数控振荡器、鉴相器、可控模N分频器。
b、 LED动态扫描电路、FPGA和单片机的数据接口，以完成两者之间的数据传递。
3、设计辅助电路：键盘、LED显示、信号源等。
4、整体测试表明：系统可以实现10Hz到1MHz的信号同步，键盘及显示电路工作正常。
关键字：单片机、电子设计自动化（EDA）、Verilog HDL、数字锁相环
在科学飞速发展的今天，世界已进入了数字化、信息化的时代。其中，通信技术的发展最为迅速。从第一代模拟移动通信，到今年即将运营的3G移动通信，仅仅数年的时间。与此同时，（微）电子技术也在以很快的速度进步着，利用FPGA作原型设计及前期样品生产的作法将会逐渐流行起来。通过使用FPGA/CPLD，可得到降低成本和上市时间快等的好处。数据通信的应用需求量很大，我国路由器产品采用FPGA/CPLD起了很大作用。伴随着微电子工业的发展，今天的FPGA已经可以做系统级芯片了。技术的融合，使得各种科学技术不再独立，而是联合应用在一起，发挥更大的功效。
本课题的目的是设计出一个具有通用性的输入信号的位同步提取系统，系统可以实现10Hz~1MHz的信号同步，使用单片机进行实时控制现场可编程逻辑门阵列FPGA完成对同步信号的提取。该系统以FPGA器件作为控制的核心，配合单片机使整个系统显得尤为精简，能达到所要求的技术指标，具有灵活的现场更改性，还有高速、精确、可靠、抗干扰性强等优点。最重要的一点便是它能实现对不同的位同步信号进行提取，能够满足本课题的要求
According To The MCU And FPGA The Bit Synchronous Signal Withdraw
ABSTRACT：This text for designing the synchronous system is an usage MCU to control the Fileld Programmable Gate Array(FPGA) really．This design primarily completes missions as below．
1、 The MCU complete solid hour measure frequency follow with auto lock the phase．
2、 In the FPGA inner part ，the design have below two parts：
a． The Digital Phase Locked Loop(DPLL)，primarly include Digital Controled Oscillatory，Pahse Detector，N Divider．
b． The LED Dynamicly scan and display circuit，Interface circuit between MCU and FPGA．
3、 Design assistant electric circuit：The keyboard，LED shows，signal source etc．
4、The whole test enunciation：the system can realize 10Hz to 1MHz signal is synchronous，keyboard electric circuit and manifestation electric circuit work is normal．
KEYWORDS：MCU EDA Verilog HDL DPLL
目 录
摘 要 I
Abstract II
引 言 1
第1章 绪 论 2
1.1 位同步技术当前的发展 2
1.2 EDA简介 3
1.3 8051型单片机 4
1.4 FPGA器件简介 4
1.4.1 FPGA器件的发展 4
1.4.2 FPGA器件的结构 5
1.4.3 Altera器件及EPM7064 7
1.5 FPGA开发过程简介 8
1.6 C语言 9
1.7 VerilogHDL 9
1.8 MAX+PLUS II 概述 10
第2章 系统组成结构 11
2.1 单片机模块 11
2.2 键盘模块 11
2.3 测频、输出显示模块 12
2.4 数字锁相环(DPLL)模块 13
第3章 各模块的具体设计及实现 14
3.1 单片机模块的设计与实现 14
3.2 键盘模块的设计与实现 15
3.2.1 设计中问题和解决方法 15
3.2.2 键盘设计的软件设计 16
3.3 测频、输出显示模块的设计与实现 17
3.3.1 测频部分 17
3.3.1.1 测频电路的设计实现 17
3.3.1.2 测频模块的软件设计 17
3.3.2 显示部分 18
3.3.2.1 7448芯片介绍 18
3.4 锁相环模块的设计与实现 21
3.4.1 鉴相器的选择 21
3.4.2 可编程K可逆计数器的设计 22
3.4.3 I/D线路的设计 24
3.4.4 可编程N分频器的设计 25
第4章 位同步信号提取系统整体测试 28
4.1 锁相环的仿真与测试 28
4.2 单片机软件的测试 29
4.3 系统的整体测试 31
参考文献 33
致 谢 34
附录A 单片机软件设计程序 35
附录B FPGA芯片内部模块的Verilog HDL设计 58
部分参考文献
[6] 邬金松，李广彪．单片机并行配置FPGA的整体实现 舰船电子工程
[7] 宋宇成，宋万杰．ALTERA系列器件的集中配置方法 电子科技，
[8] 张奎刚，徐连海，张华．ALTERA FPGA简介及其在LED显示屏控制中的应用，微处理机，
[9] 王明龙，王德祥．利用Altera可编程逻辑器件开发数字电路设计 实用测试技术
[10] 潘 松，黄继业．EDA技术使用教程 北京：科学出版社
[11] 樊昌信，张甫翊，徐炳祥，吴成柯. 通信原理 北京：国防工业出版社
[12] 王迎旭．单片机原理与应用 北京：机械工业出版社
[13] 王金明,杨吉斌．数字系统设计与Verilog HDL 北京：电子工业出版
附录A 单片机软件设计程序
#include
#include
#define uchar unsigned char
#define uint unsigned int
#define ulong unsigned long
//以下端口编址采用不完全编址，再没有用到的地址线均设为1
//采用高四位片间选择，低四位片内选择。
//主要是所使用的内部元件的编址
#define PORTH_NFPQ XBYTE[0X8F] //NFPQ 高八位地址 10001111和10001110对应DATA[3..0]
#define PORTL_NFPQ XBYTE[0X8E] // NFPQ 低八位地址.......
